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陳家聖
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Titles
容忍時序錯誤之心脈陣列設計 = = Design of Systolic Arrays for Tolerating Timing Errors /
by: 陳家聖; 紀新洲; 國立東華大學電子工程研究所
(Language materials, printed)
Subjects
時序容錯
錯誤復原設計
超大型積體電路設計
心脈陣列
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