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微處理機位址匯流排之低功率架構設計 = = Architectural...

吳長隆

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博客來

微處理機位址匯流排之低功率架構設計 = = Architectural support for low-power microprocessor address buses /

紀錄類型:	書目-語言資料,印刷品 : Monograph/item
正題名/作者:	微處理機位址匯流排之低功率架構設計 = / 吳長隆撰
其他題名:	Architectural support for low-power microprocessor address buses /
其他題名:	Architectural support for low-power microprocessor address buses
作者:	吳長隆
其他作者:	紀新洲
出版者:	民88[1999],
面頁冊數:	v,83面 : 圖,表格 ; 30公分
附註:	指導教授: 紀新洲
標題:	電腦學 -

微處理機位址匯流排之低功率架構設計 = = Architectural support for low-power microprocessor address buses /
吳長隆

微處理機位址匯流排之低功率架構設計 = Architectural support for low-power microprocessor address buses / Architectural support for low-power microprocessor address buses吳長隆撰 - 民88[1999] - v,83面 : 圖,表格 ; 30公分

指導教授: 紀新洲

碩士論文--國立東華大學資訊工程研究所,1999

參考書目: 面 70-73

贈閱Subjects--Topical Terms:

2238494
電腦學

微處理機位址匯流排之低功率架構設計 = = Architectural support for low-power microprocessor address buses /
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