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晶片網路架構之容錯尋徑設計與評估 = = Design and Eva...

陳文殊

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晶片網路架構之容錯尋徑設計與評估 = = Design and Evaluation of Fault-Tolerant Routing for Network-on-Chip Architectures /

紀錄類型:	書目-語言資料,印刷品 : Monograph/item
正題名/作者:	晶片網路架構之容錯尋徑設計與評估 = / 陳文殊撰
其他題名:	Design and Evaluation of Fault-Tolerant Routing for Network-on-Chip Architectures /
其他題名:	Design and Evaluation of Fault-Tolerant Routing for Network-on-Chip Architectures
作者:	陳文殊
其他作者:	紀新洲
出版者:	[花蓮縣壽豐鄉 : 國立東華大學資訊工程學系], : 民98[2009],
面頁冊數:	13,103面 : 圖,表 ; 30公分
附註:	指導教授︰紀新洲
標題:	內部連結網路 -
電子資源:	http://etd.lib.ndhu.edu.tw/ETD-db/ETD-search-c/view_etd?URN=etd-0728109-234331PDF全文

晶片網路架構之容錯尋徑設計與評估 = = Design and Evaluation of Fault-Tolerant Routing for Network-on-Chip Architectures /
陳文殊

晶片網路架構之容錯尋徑設計與評估 = Design and Evaluation of Fault-Tolerant Routing for Network-on-Chip Architectures / Design and Evaluation of Fault-Tolerant Routing for Network-on-Chip Architectures陳文殊撰 - [花蓮縣壽豐鄉 : 國立東華大學資訊工程學系], 民98[2009] - 13,103面 : 圖,表 ; 30公分

指導教授︰紀新洲

碩士論文--國立東華大學資訊工程學系,2009

參考書目︰面101-103Subjects--Topical Terms:

2699495
內部連結網路

晶片網路架構之容錯尋徑設計與評估 = = Design and Evaluation of Fault-Tolerant Routing for Network-on-Chip Architectures /
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